ITC-Asia2026国际会议设计竞赛正式启动
发布时间：2026-02-09
截稿时间：2026-03-15
阅读量：58次
第十届国际测试会议（亚洲）（The 10th International Test Conference in Asia，简称ITC-Asia 2026）将于2026年8月在历史文化名城宁波举行。作为集成电路测试技术领域的旗舰会议，ITC-Asia自2017年创办以来持续推动全球学术界与工业界在测试、验证与可靠性等方向的深度交流与合作。本次会议由IEEE Computer Society、TTTC及IEEE CEDA技术协办，属于CCF-C类推荐会议。会议议题覆盖AI测试、硬件安全、SoC测试、芯粒（Chiplet）与3D IC测试等前沿热点。2026年ITC-Asia将首次设立并举办开放设计竞赛，欢迎大家积极报名参加。
一、竞赛目的
随着量子计算技术的飞速发展，传统公钥密码体制（如RSA、ECC）面临严峻的安全威胁。美国国家标准与技术研究院（NIST）已正式确立后量子密码（PQC）标准。为应对这一技术变革，推动高能效硬件安全芯片技术的发展，2026 ITC-Asia组委会决定举办“2026 ITC-Asia开放设计竞赛”。本次竞赛旨在基于FPGA平台，为NIST选定的核心PQC算法设计高吞吐、低延迟、低功耗的硬件加速IP，并为参赛者提供发表高水平学术论文的国际化舞台。
二、参赛对象
本次竞赛面向全球开放：
1.高校学生：国内外高校在读本科生、硕士生、博士生。
2.企业人员：相关领域的企业工程师。
3.队伍构成：每队1-3人，可选配1-2名指导教师。
三、竞赛内容
本次竞赛主题为“面向后量子密码(PQC)的高能效硬件加速器设计”。参赛队需在指定的硬件平台上，针对以下NIST核心算法完成硬件加速设计：
1.ML-KEM(原Kyber)：密钥封装机制。
2.ML-DSA(原Dilithium)：数字签名方案。
指定硬件平台：AMD Xilinx Kria K26 SOM（所有核心设计需在PL端实现）。
四、竞赛时间安排
报名阶段：即日起至2026年3月15日。
初赛阶段：截止2026年4月26日（提交仿真方案与初步报告）。
决赛阶段：截止2026年5月24日（提交最终工程、报告及论文）。
结果公布：2026年5月29日。
五、竞赛提交物与要求
本次竞赛实行“工程+报告+论文”三轨制提交，所有获奖作品将开源。
1.完整工程源码：包含PL端RTL/HLS源码、PS端Host代码、约束文件及构建脚本（Tcl/Makefile），需附带详细的复现说明（README.md）。
2.技术报告：详细阐述架构设计、优化策略及性能/功耗分析。
3.学术论文：参赛队需提交符合IEEE ITC-Asia 2026投稿要求（标准IEEE会议模板，不超过6页）的学术论文。
六、竞赛评分标准
本次竞赛总分100分，遵循“板级实测速度为主，工具估算功耗为辅”的原则。
1.约束与合规性（前置条件）：资源不超标、无时序违例、通过官方测试向量(KAT)验证。
2.能效指标分（80分）：采用EDP（能量-延迟积）模型评分。公式为：Score=80×(Cost_min/Cost_team)，其中Cost取决于动态功耗与硬件实测耗时。
3.技术报告分（20分）：涵盖架构设计的合理性、低功耗优化策略及文档质量。
七、竞赛奖励办法
组委会设立丰厚奖金及学术激励：
第一名：USD 1450或CNY 10000
第二名：USD 1150或CNY 8000
第三名：USD 850或CNY 6000
优秀奖：3支队伍（获荣誉证书）
特别奖励：所有获奖队伍提交的学术论文，将推荐至IEEE ITC-Asia 2026会议录用发表。
八、报名与联系方式
1.报名方式：
请填写Google Form报名表
https://docs.google.com/forms/d/e/1FAIpQLSfRrz8O6TVQrpd7JuUPAXoLSr8xeEQ9dRXMWg4G5J6IRwaWpA/viewform?usp=publish-editor
2.官方交流渠道：
Teams群：（官方答疑与交流窗口）
https://teams.live.com/l/invite/FEAKQOtgbzMeixFNgI?v=g1
联系邮箱：c130044@163.com
3.参考资料：
软件算法及论文参考库：
https://github.com/Itc-asia/PQC_FPGA.git
竞赛官网指南
一、竞赛目的
随着量子计算技术的飞速发展，传统公钥密码体制（如RSA、ECC）面临严峻的安全威胁。美国国家标准与技术研究院（NIST）已正式确立后量子密码（PQC）标准。为应对这一技术变革，推动高能效硬件安全芯片技术的发展，2026 ITC-Asia组委会决定举办“2026 ITC-Asia开放设计竞赛”。本次竞赛旨在基于FPGA平台，为NIST选定的核心PQC算法设计高吞吐、低延迟、低功耗的硬件加速IP，并为参赛者提供发表高水平学术论文的国际化舞台。
二、参赛对象
本次竞赛面向全球开放：
1.高校学生：国内外高校在读本科生、硕士生、博士生。
2.企业人员：相关领域的企业工程师。
3.队伍构成：每队1-3人，可选配1-2名指导教师。
三、竞赛内容
本次竞赛主题为“面向后量子密码(PQC)的高能效硬件加速器设计”。参赛队需在指定的硬件平台上，针对以下NIST核心算法完成硬件加速设计：
1.ML-KEM(原Kyber)：密钥封装机制。
2.ML-DSA(原Dilithium)：数字签名方案。
指定硬件平台：AMD Xilinx Kria K26 SOM（所有核心设计需在PL端实现）。
四、竞赛时间安排
报名阶段：即日起至2026年3月15日。
初赛阶段：截止2026年4月26日（提交仿真方案与初步报告）。
决赛阶段：截止2026年5月24日（提交最终工程、报告及论文）。
结果公布：2026年5月29日。
五、竞赛提交物与要求
本次竞赛实行“工程+报告+论文”三轨制提交，所有获奖作品将开源。
1.完整工程源码：包含PL端RTL/HLS源码、PS端Host代码、约束文件及构建脚本（Tcl/Makefile），需附带详细的复现说明（README.md）。
2.技术报告：详细阐述架构设计、优化策略及性能/功耗分析。
3.学术论文：参赛队需提交符合IEEE ITC-Asia 2026投稿要求（标准IEEE会议模板，不超过6页）的学术论文。
六、竞赛评分标准
本次竞赛总分100分，遵循“板级实测速度为主，工具估算功耗为辅”的原则。
1.约束与合规性（前置条件）：资源不超标、无时序违例、通过官方测试向量(KAT)验证。
2.能效指标分（80分）：采用EDP（能量-延迟积）模型评分。公式为：Score=80×(Cost_min/Cost_team)，其中Cost取决于动态功耗与硬件实测耗时。
3.技术报告分（20分）：涵盖架构设计的合理性、低功耗优化策略及文档质量。
七、竞赛奖励办法
组委会设立丰厚奖金及学术激励：
第一名：USD 1450或CNY 10000
第二名：USD 1150或CNY 8000
第三名：USD 850或CNY 6000
优秀奖：3支队伍（获荣誉证书）
特别奖励：所有获奖队伍提交的学术论文，将推荐至IEEE ITC-Asia 2026会议录用发表。
八、报名与联系方式
1.报名方式：
请填写Google Form报名表
https://docs.google.com/forms/d/e/1FAIpQLSfRrz8O6TVQrpd7JuUPAXoLSr8xeEQ9dRXMWg4G5J6IRwaWpA/viewform?usp=publish-editor
2.官方交流渠道：
Teams群：（官方答疑与交流窗口）
https://teams.live.com/l/invite/FEAKQOtgbzMeixFNgI?v=g1
联系邮箱：c130044@163.com
3.参考资料：
软件算法及论文参考库：
https://github.com/Itc-asia/PQC_FPGA.git
竞赛官网指南
https://www.castest.com.cn/itcasia2026_competition
https://mp.weixin.qq.com/s/mcJK7F1HyySA1ibLgoZVcg
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